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数据总线、涉及电路、寄存器、逻辑设计设数据总线上接有A、B、C、D4个寄存器,要求选用合适的74系列芯片,完成下列逻辑设计:1、设计一个电路,在同一时间实现D到A,D到B,和D到C寄存
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数据总线、涉及电路、寄存器、逻辑设计
设数据总线上接有A、B、C、D4个寄存器,要求选用合适的74系列芯片,完成下列逻辑设计:
1、设计一个电路,在同一时间实现D到A,D到B,和D到C寄存器间的传送。
2、设计一个电路,实现下列操作:T0时刻完成D到总线。
T1时刻完成总线到A.
T2时刻完成A到总线。
T3时刻完成总线到B。
设数据总线上接有A、B、C、D4个寄存器,要求选用合适的74系列芯片,完成下列逻辑设计:
1、设计一个电路,在同一时间实现D到A,D到B,和D到C寄存器间的传送。
2、设计一个电路,实现下列操作:T0时刻完成D到总线。
T1时刻完成总线到A.
T2时刻完成A到总线。
T3时刻完成总线到B。
▼优质解答
答案和解析
1)你需要8bit锁存器,如377,373等;
2)需要8bit总线驱动器,是3态的,如245、373等;
3)需要个时钟脉冲计数分频器或移位器,如4017等;
第一个问题:需要一个数据总线驱动芯片,及4个锁存器。如用377,则需要5个;
第二个问题:结构形式如同上一个问题,关键是时序问题,控制好数据锁存及输出高阻态,因为几个锁存器的输入输出都对应连接在一起了。
你先想想下吧
2)需要8bit总线驱动器,是3态的,如245、373等;
3)需要个时钟脉冲计数分频器或移位器,如4017等;
第一个问题:需要一个数据总线驱动芯片,及4个锁存器。如用377,则需要5个;
第二个问题:结构形式如同上一个问题,关键是时序问题,控制好数据锁存及输出高阻态,因为几个锁存器的输入输出都对应连接在一起了。
你先想想下吧
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