假设某CPU的基本总线周期有4个状态,分别为T1、T2、T3、T4。系统规定,在 T2开始时发读写命令,在T4开始
假设某CPU的基本总线周期有4个状态,分别为T1、T2、T3、T4。系统规定,在 T2开始时发读写命令,在T4开始时信息要读出到数据总线或写入到存储体。为适应访问慢速存储体的需要,必须在原4个状态中,固定插入一个等待状态Tw,则Tw应插在( )。
A.T1之前
B.T1之后T2之前
C.T3之后T4之前
D.T4之后
解析:为适应访问慢速存储体的需要,要在原4个状态中,固定插入一个等待状态Tw,那么Tw应插在Tw之后T4之前。
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