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用VHDL编写的计数器,能通过语法检测,但不可以综合,哪里出错了?提示Variablei:stdlogicvector(7downto0)中的“i”有以下错误：“Signalicannotbesynthesized,
badsynchronousdescription
.T
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VHDLVGA中的综合问题Signalcolourcannotbesynthesized,
badsynchronousdescription
.Thedescriptionstyleyouareusingtodescribeasynchronouselement(reg
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ronous element
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