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共找到 1 与INPUT;clock 相关的结果，耗时1 ms
请问如下程序是Verilog还是VHDL语言写的.PARAMETERS(WIDTH=4,DEPTH=0);SUBDESIGNaltshift(data[(WIDTH-1)..0]:
INPUT;clock
:INPUT=GND;aclr:INPUT=GND;clken:IN
其他
= GND;clken :
1
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